至此，我们已经将altera相关的库文件添加到了Modelsim SE中了。后面，我们将介绍如何通过do文件启动仿真。1.1.2.&&原理介绍&&&&&&介绍PLL IP核建立之前，我们先讲一下PLL的基本原理。PLL是Phase-Locked Loop的缩写，中文含意为锁相环。PLL基本上是一个闭环的反馈控制系统，它可以使PLL输出与一个参考信号保持固定的相位关系。PLL一般由鉴相器、电荷放大器（Charge Pump）、低通滤波器、（电）压控振荡器、以及某种形式的输出转换器组成。为了使得PLL的输出频率是参考时钟的倍数关系，在PLL的反馈路径或（和）参考信号路径上还可以放置分频器。PLL的功能示意图如下图所示：首先大家要理解什么是压控振荡器(VCO)，压控振荡器实际就是一个：频率--电压转换器。当VCO输入的电压变化时，对应输出的频率也会发生变化。PLL的工作原理就是将VCO输出的频率经过分频器返回到输入端，将分频信号与原始输入的信号鉴相，鉴相器输出又通过电压放大器和低通滤波器并转换成电压，这样就调整了VCO的输入电压，从而调整了VCO的输出频率，然后这样循环调整，最终将输出频率锁定。1.1.3.&&建立IP核第一步：按照2.4.2节的方法新建pll_test工程，这里我们就不重复了，新建好工程以后。选择菜单栏Tools--&MegaWizard Plug-In Manager。其中MegaWizard就是Quartus的IP核建立向导工具，我们通过这个工具建立我们需要的IP核。第二步：弹出如下对话框，选择“Create a new custom megafunction variation”创建一个新的IP核。点击Next。第三步：弹出如下对话框，首先介绍一下IP核搜索栏，我们可以通过这个地方快速查找到需要的IP核的位置，我们输入pll，便可以迅速找到PLL的IP核，ALTPLL，如下图。这里生成IP核文件，我们选择为Verilog。
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xilinx封装个人ip核的方法
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