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高级数字IC设计工程师，在全球top10的IC公司工作NNN年+具有丰富的数字IC设计经验
| 夲课程的内容包括硬件描述语言的基本概念、Verilog基本语法、高级描述语句、基本的数字IC模块设计，Verilog2001的新增特性和RTL编码规范 |
支持随到随学23年10月过期
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高级数字IC设计工程师，在全球top10的IC公司工作NNN年+具有丰富的数字IC设计经验
| 夲课程的内容包括硬件描述语言的基本概念、Verilog基本语法、高级描述语句、基本的数字IC模块设计，Verilog2001的新增特性和RTL编码规范 |
一阶段 集成电路前端设计
9.数字前端全流程设计工具
10.相关工艺库文件计算机操作系统UNIX应用；
11.数字电路逻辑设计；
12.硬件描述语言HDL和逻辑综合初步；
13.集成电路设计导论及流程；
14.半导体器件原理及集成电路概论；
18. 数字系统设计与FPGA现成集成；
静态时序分析（STA）；
可测性设计（DFT）；
二阶段 数字集成电路后端设计
7.静态时序分析（STA）
10.数字后端全流程设计工具
12.半导体器件原理及集成电路概论；
13.集成电路设计导论及流程；
15.版图设计工具及使用方法；
17.CMOS集成电路设計原理；
19.IC布局布线设计；
20.版图验证和提取；
25.标准单元库设计；
26.单元库的各种库文件；
27.各种单元的功能结构和版图。
3工作环境的设立和關键命令
4，综合前的准备工作
5芯片逻辑代码和流片厂库的结合
7， 综合后网表的导出
1.网表和工程库的结合
2环境变量的设置和关键命令
3,咘局布线前的准备工作
1，环境变量的设置和关键命令
3快速建立工作环境的方法
4，焊盘库和工艺库的建立
9焊盘、封装与芯片的管脚规划
4，仿真验证报告的产生
6TCL脚本的使用技巧
1、代码编写及仿真技巧
系统介绍verilog语法规范、语言与电路实现之关系，以及RTL仿真技术、RTL代码编写技巧、控制单元和数据通路单元的实现技巧、基于Verilog语言的测试编码技巧功能验证及Testbench搭建的技巧。
讲述综合基础、组合电路与时序电路、基於TCL的综合流程、综合策略、设计环境和设计约束的制定、综合优化的技巧、实现优化结果的可综合代码编写技术等
基于Synopsys DFT compiler的DFT技术，介绍可測性设计技术、组合电路和时序电路的测试方法、基于TCL的DFT设计实现的基本流程
基于Synopsys PT的静态时序分析技术，介绍静态时序分析、基于TCL技术嘚处理过程和常用的时序分析方法
本课程专题实验是构造一个ARM9的处理器，
ARM9芯片后端设计整个流程项目实战演练使用后端的Synopsys公司的DC,PT等工具，
和Cadence公司的Encounter,Virtuoso等工具多工具联合从头至尾强化练习整个芯片的生成过程。
3）数据缓冲和指令缓冲
4）内部数据ram和指令RAM
和Cadence公司的Encounter,Virtuoso等工具多笁具联合从头至尾强化练习整个芯片的生成过程。